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光芯片走向Chiplet,颠覆先进封装

倩倩 来源:半导体行业观察 作者:半导体行业观察 2022-08-24 09:46 次阅读

几年前,Lightmatter 通过展示人工智能加速器 Mars 引起了轰动,该加速器重新思考了电子计算和移动数据的范式。他们展示了一种使用光子学进行计算的处理器。该芯片承诺将延迟、带宽和功率提高多个数量级。由于芯片所涉及的软件和计算结构的刚性,这最终没有成功。

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Lightmatter 已经创建了名为 Envise 的第二代 AI 计算产品,但这不是今天帖子的重点。我们想分享 Lightmatter 在他们的最新产品 Passage 上展示的内容。总结就是,Lightmatter 希望通过 Passage 打破高级封装和 IO 的限制。

众所周知,AI 和 HPC 等领域的问题规模呈指数级增长,但摩尔定律无法跟上。

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因此,该行业已转向使用chiplet来组合更大的封装,以继续满足计算需求。将芯片分解成许多chiplet并超过标线限制(光刻工具的图案化限制的物理限制)将实现持续缩放,但这种范例仍然存在问题。即使采用先进的封装,将数据移出芯片的电力成本也将成为限制因素。此外,即使采用最先进的封装形式,带宽仍然有限。

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Lightmatter 不想将硅放在硅上,而是希望通过 Passage 颠覆先进的封装游戏。Passage 连接到光学中介层上的 48 个客户芯片。Passage 建立在GlobalFoundries Fotonix 45CLO 工艺技术之上。它旨在以非常高的带宽和性能连接许多芯片。这种optical interposer打破了带宽限制,在每个tile之间提供每秒 768 太比特,并且可以以每秒 128 太比特扩展到多个interposers,这是传统封装无法达到的能力和规模水平。

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几十年来,光学一直承诺解决电气 IO 的瓶颈。技术在这方面的进展缓慢。Lightmatter 称之为 Gen 1 的可插拔光学器件多年来一直用于连接数据中心内的交换机。由于英特尔和Ayar Labs等公司,第 2 代和第 3 代光学器件(将光学器件放在同一个封装上或直接连接)开始进入网络交换机和计算领域。Lightmatter 想通过 Passage 直接跳到第 4 代和第 5 代。

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英特尔和 Ayar Labs 等标准联合封装光学器件的规模比 Lightmatter 使用的光学中介层解决方案低一个数量级。其互连密度高出 40 倍,因为单个芯片中只能插入大约 200 根光纤。此外,互连是完全静态的,而 Passage 具有可动态配置的结构。

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这种光中介层可以在芯片之间进行交换和路由。整个互连可以在 1ms 内重新配置。

Lightmatter 表示,他们可以支持所有拓扑,例如 all to all、1D ring、Torus、Spine 和 Leaf 等等。Passage 的交换和路由在 48 芯片阵列上的任何芯片与任何其他芯片之间的最大延迟为 2ns。

切换是通过使用环形谐振器调制颜色并使用马赫-曾德干涉仪来引导它们来实现的。

Lightmatter 的光子晶圆级中介层具有 A0 硅,并声称每个站点使用的功率不到 50 瓦。每个站点有 8 个混合激光器驱动 32 个通道;每个通道运行 32Gbps NRZ。

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Lightmatter 的晶圆级硅光子芯片主要采用硅基制造技术;它有许多相同的限制。即光刻工具的标线限制。GlobalFoundries 和 Lightmatter 通过缝合波导解决了这个问题。纳米光子波导的光罩间连接在每个光罩交叉处仅具有 0.004 dB 的损耗。波导损耗为 0.5 dB/cm,每个 Mach-Zehnder 干涉仪损耗为 0.08 dB。每次交叉也有 0.028 dB 的损耗。

Lightmatter 表示,借助 UCIe,他们可以运行最高规格的 32Gbps chiplet到中介层互连。如果使用直接 SERDES,他们相信它们可以以 112G 的速度运行。客户 ASIC 被 3D 封装在中介层之上。然后 OSAT 将组装这个最终产品。它可以有多种变体,从 48 个芯片到只有 8 个芯片的更小的interposer。passage封装还必须为封装在顶部的芯片供电。它通过使用 TSV 为每个tile提供高达 700W 的功率来做到这一点。在这个功率级别需要水冷,但如果客户 ASIC 消耗较少,他们可以使用空气冷却。

请注意,声称的 768Tbps 似乎在很大程度上被浪费了。它们的功能似乎允许它们将一个输入耦合到一个输出。这使得大部分互连空闲。为了让他们找出不冲突的途径,这将是必要的。这些路径是被动的,在不使用时几乎不会浪费电力。MZI 元素向左或向右。没有混合(blending),没有多播(multicasting)。一进一出。

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Lightmatter 还举了一个分解内存设计和多租户架构的例子。他们开始他们的 interposer可以支持任何协议,包括 CXL。interposer顶部的客户 ASIC 可以通过重新配置网络实现气隙,因此在特定芯片之间传递数据是不可能的。最大的问题是产品是否会出现以及何时会出现。这可能只是vaporware,也可能是高端领先的分类服务器设计的未来。Lightmatter 必须吸引其他公司为这个平台制造芯片。这些公司必须将其昂贵的开发信任与未经证实的合作伙伴。

审核编辑 :李倩

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    半导体芯片先进封装——CHIPLET

    Chiplet可以使用更可靠和更便宜的技术制造。较小的硅片本身也不太容易产生制造缺陷。此外,Chiplet芯片也不需要采用同样的工艺,不同工艺制造的Chiplet可以通过先进封装技术集成在一起。
    发表于 10-06 06:25 8669次阅读

    什么是Chiplet技术?chiplet芯片封装为啥突然热起来

    最近两天经常看到Chiplet这个词,以为是什么新技术呢,google一下这不就是几年前都在提的先进封装吗。最近资本市场带动了芯片投资市场,和chiplet有关的公司身价直接飞天。带着好奇今天扒一扒
    发表于 10-20 17:42 4148次阅读
    什么是<b>Chiplet</b>技术?<b>chiplet</b><b>芯片</b><b>封装</b>为啥突然热起来

    UCIe生态正在完善,Chiplet腾飞指日可待

    芯片厂商进入下一个关键创新阶段并打破功率-性能-面积(PPA)天花板的一个绝佳技术选择。 采用Chiplet的方式,可将不同功能的芯片通过2D或2.5D/3D的封装方式组装在一起,并可以以异构的方式在不同工艺节点上制造,但是到目前为止,实现Chiplet架构一直非常困难。为了
    的头像 发表于 11-10 11:15 304次阅读

    Chiplet芯片的时代机遇与趋势

    高性能计算(HPC)市场进入超预期的高速发展阶段,先进封装Advanced Packaging成为高性能运算芯片成功与否的关键技术。在第十四届中国集成电路封测产业链创新发展高峰论坛(CIPA 2022)“高峰论坛”上,矽品研发中心副总经理王愉博博士与产业探讨未来高性能计算的先进封装发展趋势
    的头像 发表于 11-10 15:07 548次阅读

    Chiplet芯片异构在制造层面的效率优化

    实际上,Chiplet 最初的概念原型出自 Gordon Moore 1965年的论文《Cramming more components onto integrated circuits
    发表于 11-17 15:34 509次阅读

    全球半导体芯片巨厂布局Chiplet技术

    Chiplet 芯片一般采用先进封装工艺,将小芯片组合代替形成一个大的单片芯片。利用小芯片(具有相对低的面积开销)的低工艺和高良率可以获得有效降低成本开销。
    发表于 11-18 11:48 863次阅读

    如何跑步进入Chiplet时代?

    封装行业正在努力将小芯片(chiplet)的采用范围扩大到几个芯片供应商之外,为下一代 3D 芯片设计和封装奠定基础。
    发表于 12-02 14:54 203次阅读

    芯片封装散热解决方案

    先进封装芯片不仅能满足高性能计算、人工智能、功率密度增长等的需求,同时先进封装的散热问题也变得复杂。因为一个芯片上的热点会影响到邻近芯片的热量分布。芯片之间的互连速度在模块中也比在SoC中要慢。
    的头像 发表于 12-05 14:45 499次阅读

    跨工艺、跨封装Chiplet多芯粒互连挑战与实现|智东西公开课预告

    芯片制造过程中成本的进一步优化,Chiplet异构集成技术逐渐成为了业内的焦点。 为了让大家更深入的了解Chiplet技术,今年12月起,智东西公开课硬科技教研组全新策划推出「Chiplet技术系列直播课」。 12月19日 (周一) 晚19点 , 芯动科技技
    的头像 发表于 12-16 11:30 359次阅读

    Chiplet开启了IP新型复用模式

    Chiplet又称芯粒或小芯片,是先进封装技术的代表,将复杂芯片拆解成一组具有单独功能的小芯片单元 die(裸片),通过 die-to-die 将模块芯片和底层基础芯片封装组合在一起。
    的头像 发表于 12-16 14:26 406次阅读

    中国首个原生Chiplet芯片标准来了

    或许大家对Chiplet还不太了解,简单来说,Chiplet技术就是对原本复杂的SoC芯片的解构,将满足特定功能的裸片通过die-to-die内部互连技术与底层基础芯片封装组合在一起,类似于搭建乐高积木一般
    的头像 发表于 12-21 15:49 1050次阅读

    世芯电子正式加入UCIe产业联盟参与定义高性能Chiplet技术的未来

    chiplet芯片封装需求。它是一种开放的行业互联标准,可在Chiplet之间提供高带宽、低延迟、节能且具有成本效益的封装连接,使得开放的Chiplet生态
    的头像 发表于 12-22 20:30 1349次阅读

    芯动兼容UCIe标准的最新Chiplet技术解析

    演讲,就行业Chiplet技术热点和芯动Innolink Chiplet核心技术,与腾讯、阿里、中兴、百度、是得科技等知名企业,以及中科院物理所、牛津大学、上海交大等学术科院领域名家交流分享,共同助推Chiplet互连技术的创新与应用。 多晶粒Chiplet技术是通过各种不同的工艺和封装
    的头像 发表于 12-23 20:55 1051次阅读

    先进封装Chiplet全球格局分析

    Chiplet 封装领域,目前呈现出百花齐放的局面。Chiplet 的核心是实现芯片间的高速互 联,同时兼顾多芯片互联后的重新布线。
    发表于 01-05 10:15 558次阅读

    长电科技Chiplet系列工艺实现量产

    出货,最大封装体面积约为1500mm²的系统级封装。 随着近年来高性能计算、人工智能、5G、汽车、云端等应用的蓬勃发展,要求芯片成品制造工艺持续革新以弥补摩尔定律的放缓,先进封装技术变得越来越重要。应市场发展之需,长电科技于2021年7月正式推出面向Chiplet(小
    的头像 发表于 01-05 11:42 642次阅读

    Chiplet是新蓝海,是国产设计大机遇

    所谓Chiplet,通常被翻译为“粒芯”或“小芯片”,单从字面意义上可以理解为“粒度更小的芯片”。它是一种在先进制程下提升芯片的集成度,在不改变制程的前提下提升算力,并保证芯片制造良品率的一种手段。
    的头像 发表于 01-06 10:10 328次阅读

    中国芯片设计应布局Chiplet架构介绍

    3D5000芯片是使用Chiplet芯片粒)技术把两块之前发布的3C5000芯片互联和封装在一起,其中每块3C5000芯片粒有16个核心,从而实现3D5000的32核设计。
    发表于 01-09 15:08 523次阅读

    半导体先进封装市场简析(2022)

    采用了先进的设计思路和先进的集成工艺、缩短引线互连长度,对芯片进行系统级封装的重构,并且能有效提高系统功能密度的封装。现阶段的先进封装是指:倒装焊(FlipChip)、晶圆级封装(WLP)、2.5D封装(Interposer、RDL)
    的头像 发表于 01-13 10:58 391次阅读

    国产封测厂商竞速Chiplet,能否突破芯片技术封锁?

    在摩尔定律已接近极致的当下,Chiplet技术由于可以有效的平衡芯片效能、成本以及良率之间的关系,近年来深受人们关注。尤其是在国产芯片遭遇种种技术封锁的背景下,人们对于国产芯片通过Chiplet技术绕开先进制程领域遭到的封锁饱含期待。
    的头像 发表于 01-16 15:28 270次阅读

    3D IC先进封装的发展趋势和对EDA的挑战

    随着集成电路制程工艺逼近物理尺寸极限,2.5D/3D封装,芯粒(Chiplet)、晶上系统(SoW)等先进封装成为了提高芯片集成度的新方向,并推动EDA方法学创新。这也使得芯片设计不再是单芯片的问题,而逐渐演变成多芯片系统工程。
    的头像 发表于 01-29 09:31 204次阅读

    何谓先进封装/Chiplet先进封装/Chiplet的意义

    先进封装/Chiplet可以释放一部分先进制程产能,使之用于更有急迫需求的场景。从上文分析可见,通过降制程和芯片堆叠,在一些没有功耗限制和体积空间限制、芯片成本不敏感的场景,能够减少对先进制程的依赖。
    发表于 01-31 10:04 1903次阅读

    先进封装/Chiplet如何提升晶圆制造工艺的良率

    芯片升级的两个永恒主题:性能、体积/面积。芯片技术的发展,推动着芯片朝着高性能和轻薄化两个方向提升。而先进制程和先进封装的进步,均能够使得芯片向着高性能和轻薄化前进。
    发表于 02-14 10:43 552次阅读
    <b>先进</b><b>封装</b>/<b>Chiplet</b>如何提升晶圆制造工艺的良率

    国内Chiplet主要规划采用什么制程?28nm堆叠能达到14nm性能吗?

    目前阶段开始有同构集成。国际上已经有异构集成CPU+GPU+NPU的Chiplet,其他功能芯片则采用次先进工艺制程的芯粒,感存算一体属于3DIC的Chiplet这样的方案可以灵活堆出算力高达200tops。
    发表于 02-14 15:00 887次阅读

    华邦电子加入UCIe产业联盟,支持标准化高性能chiplet接口

    ™)产业联盟。结合自身丰富的先进封装(2.5D/3D)经验,华邦将积极参与UCIe产业联盟,助力高性能chiplet接口标准的推广与普及。   UCIe产业联盟联合了诸多领先企业,致力于推广UCIe开放标准
    发表于 02-15 10:38 242次阅读
    华邦电子加入UCIe产业联盟,支持标准化高性能<b>chiplet</b>接口

    通富微电:可提供多种Chiplet封装解决方案,产品实现大规模量产

    2月15日消息,通富微电发布公告称,公司通过在多芯片组件、集成扇出封装、2.5D/3D等先进封装技术方面的提前布局,可为客户提供多样化的Chiplet封装解决方案,并且已为AMD大规模
    的头像 发表于 02-21 01:15 230次阅读

    开年首会再创新高!先进封装与键合技术同芯创变,燃梦赢未来!

    ,并且不再局限于同一颗芯片或同质芯片,比如Chiplet、CWLP、SiP、堆叠封装、异质集成等。与之相生相伴的键合技术不断发展。在先进封装的工艺框架下,传统的芯片键合(Die Bonding)和引线键合(Wire Bonding)技术不再适用,晶圆键合(Waf
    的头像 发表于 02-28 11:29 287次阅读
    开年首会再创新高!<b>先进</b><b>封装</b>与键合技术同芯创变,燃梦赢未来!

    先进封装三种技术:IPD/Chiplet/RDL技术

    工艺选择的灵活性。芯片设计中,并不是最新工艺就最合适。目前单硅SoC,成本又高,风险还大。像专用加速功能和模拟设计,采用Chiplet,设计时就有更多选择。
    发表于 03-08 10:17 510次阅读

    先进封装“内卷”升级

    SiP是一个非常宽泛的概念,广义上看,它囊括了几乎所有多芯片封装技术,但就最先进SiP封装技术而言,主要包括 2.5D/3D Fan-out(扇出)、Embedded、2.5D/3D Integration,以及异构Chiplet封装技术。
    的头像 发表于 03-20 09:51 391次阅读

    关于Chiplet的十个问题

    chiplet 和 3D 封装面临多重挑战。多小芯片设计工具、热管理、中介层选择、互连方法,例如硅通孔 (TSV)、倒装芯片、混合键合、凸块和测试,尤其是单个小芯片和中间组装阶段。标准将有助于缓解一些挑战,但最终还是要以经济的方式满足客户的要求。
    的头像 发表于 03-27 11:51 345次阅读

    什么是ChipletChiplet与SOC技术的区别

    与SoC相反,Chiplet是将一块原本复杂的SoC芯片,从设计时就先按照不同的计算单元或功能单元对其进行分解,然后每个单元选择最适合的半导体制程工艺进行分别制造,再通过先进封装技术将各个单元彼此互联,最终集成封装为一个系统级芯片组。
    发表于 03-29 10:59 199次阅读

    芯原助力蓝洋智能部署基于Chiplet架构的芯片产品

    蓝洋智能面向高性能计算 (HPC) 、AI和计算平台的芯片产品采用了可扩展的Chiplet技术,具备通用可编程,可支持多个行业和客户从边缘端到云端的产品应用。该公司利用其先进架构和BxLink专利技术,将其创新的微架构、硬件和软件开发环境进行集成,可提供完全可扩展的解决方案
    的头像 发表于 03-30 10:38 583次阅读

    Chiplet技术给EDA带来了哪些挑战?

    Chiplet技术对芯片设计与制造的各个环节都带来了剧烈的变革,首当其冲的就是chiplet接口电路IP、EDA工具以及先进封装
    发表于 04-03 11:33 96次阅读

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