[问答]

【verilog每日一练】二进制数值中1的个数奇偶判断

945 Verilog fpga

本帖被以下淘专辑推荐:

2023-8-15 10:42:24   1 评论 分享淘帖1 邀请回答 举报
1 条评论
  • 2023-8-16 10:32

    答案:reg〔7:0〕a;
    reg flag;
    always@(posedge clk)
    begin
       flag<=⋀a

    解析:按位异或,^a等效于a[7]^a[6]^a[5]^a[4]^a[3]^a[2]^a[1]^a[0],二进制中1的个数为奇数个的时候结果为1,二进制中11的个数为偶数个的时候结果为0

9个回答
2023-8-15 17:20:53 评论

举报

2023-8-15 17:24:25 评论

举报

2023-8-15 19:02:27 评论

举报

评分

参与人数 1积分 +1 收起 理由
钱之豪 + 1 说的好

查看全部评分

2023-8-15 21:08:52 评论

举报

2023-8-16 10:05:28 评论

举报

2023-8-16 10:40:14 评论

举报

2023-8-16 11:25:48 评论

举报

2023-8-16 19:53:55 评论

举报

撰写答案

你正在撰写答案

如果你是对答案或其他答案精选点评或询问,请使用“评论”功能。

您需要登录后才可以回帖 登录/注册

声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表电子发烧友网立场。文章及其配图仅供工程师学习之用,如有内容图片侵权或者其他问题,请联系本站作侵删。 侵权投诉
快速回复

扫一扫,分享给好友

复制链接分享
返回顶部 返回列表
关注微信公众号

电子发烧友网

电子发烧友论坛

社区合作
刘勇
联系电话:15994832713
邮箱地址:liuyong@huaqiu.com
社区管理
elecfans短短
微信:elecfans_666
邮箱:users@hauqiu.com
链接复制成功,分享给好友